Board Control Status Registers (BCSR)
10.9
BCSR8
Table 16. BCSR8 Register
Bit
Config Signals
Function
Default
Att
? 1: Enable UCC2_GETH, RGMII, or RTBI
[0]
UCC2_GETH
? 0: Disable UCC2_GETH OR enable UCC2_RMII
[1]
R,W
(RMII2) on PIB
[1]
[2]
[3]
[4]
[5]
[6]
[7]
UCC2_RGMII
UCC2_RTBI
G2DIS_125
G2ENA_XC
CS_NOR
UEM Marvell PHY RESET
DDRDRV_SEL
? 1: Enable RGMII
? 0: Disable RTBI AND enable RMII on PIB
? 1: Enable RTBI
? 0: Disable RGMII AND enable RMII on PIB
? 1: Disable PHY2 clock_out 125MHz
? 0: Enable PHY2 clock_out 125MHz
? 1: Enable
? 0: Disable
? 1: Boot from NAND_FLASH
? 0: Boot from NOR_FLASH
? 1: RESET UEM3 (UCC3) and UEM4 (UCC4)
? 0: Normal operation
? 1: MEMC1,2: MDIC0,1=36.5OHm
? 0: MEMC1,2: MDIC0,1=18OHm
[1]
[0]
[0]
[0]
[0]
[0]
[1]
R,W
R,W
R,W
R,W
R,W
R,W
R,W
10.10 BCSR9
Table 17. BCSR9 Register
Bit
Config Signals
Function
Default
Att
? 1: Enable UCC3_GETH
– Use UEM module on PB for RGMII or RTBI.
[0]
UCC3_GETH
? 0: Disable UCC3_GETH OR enable (depending upon
[1]
R,W
UCC3_RMII bit) UCC3_RMII (RMII3) on PIB or
TDM1C
[1]
[2]
UCC3_RGMII
UCC3_RTBI
? 1: Enable RGMII on UEM
? 0: Disable RTBI on UEM AND enable RMII3 on PIB
? 1: Enable RTBI on UEM
? 0: Disable RGMII on UEM AND enable RMII3 on PIB
[1]
[0]
R,W
R,W
? If UCC3_GETH = 0
– then bit = 1 enables UCC3_RMII on PIB
[3]
UCC3_RMII
– then bit =0 enables TDM1C and UPC1_DEV2
[0]
R,W
? If UCC3_GETH = 1
– then bit has no effect
MPC8569E-MDS-PB Hardware Getting Started, Rev. 3.1
Freescale Semiconductor
23
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